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極限集積化デバイスのしきい値支配因子自己収束プロセスの研究

Research Project

Project/Area Number 08238202
Research Category

Grant-in-Aid for Scientific Research on Priority Areas

Allocation TypeSingle-year Grants
Research InstitutionTohoku University

Principal Investigator

森田 瑞穂  東北大学, 工学部, 助教授 (50157905)

Co-Investigator(Kenkyū-buntansha) 小谷 光司  東北大学, 工学部, 助手 (20250699)
Project Period (FY) 1996
Project Status Completed (Fiscal Year 1996)
Budget Amount *help
¥2,000,000 (Direct Cost: ¥2,000,000)
Fiscal Year 1996: ¥2,000,000 (Direct Cost: ¥2,000,000)
Keywordsデバイス / プロセス / シリコン酸化膜
Research Abstract

しきい値のばらつきが極めて小さい極限集積化デバイスを実現するために、しきい値支配因子が自己収束するゲート酸化膜形成プロセスを開発する目的に対して、極限集積化デバイスを実現するうえで不可欠な極めて薄いシリコン酸化膜を形成するウェット熱酸化プロセスにおいて、水分に水素ガスを添加することにより、酸化速度が小さくなることを見いだして、この条件で形成された酸化膜の厚さは酸化時間のゆらぎに対してばらつきが小さく、酸化膜厚さが自己収束することを明らかにしている。さらに、水分に水素ガスを添加して形成した極めて薄い酸化膜は、絶縁破壊電荷量が大きいことと、酸化膜中のトラップが少ないため電気的ストレスに対してしきい値の変動が小さいことを明らかにしている。そのうえ、熱酸化とゲート電極形成の連続プロセスにより、酸化膜表面へのハイドロカーボン付着を抑止できるため、MOS構造の初期絶縁耐圧特性が改善され、電気的特性の均一性が向上することを明らかにしている。また、シリコン酸化膜の厚さをより高い精度で制御するために、X線光電子分光測定中に酸化膜/シリコン構造試料にキセノンランプ光を照射することにより、酸化膜の帯電を低減できることを明らかにして、酸化膜の厚さおよび構造を精密に測定する方法を開発している。次に、極めて薄いゲート酸化膜上に、ミッドギャップ材料のひとつであるタンタルをゲート電極として形成した完全空乏化SOI微細MOSFETを製作し、超清浄低温プロセスにより金属ゲート電極構造においても極めて薄いゲート酸化膜の劣化や基板シリコン中での欠陥発生を抑止でき、電気的特性のばらつきが小さい高性能デバイスが製作可能であること明らかにしている。

Report

(1 results)
  • 1996 Annual Research Report
  • Research Products

    (4 results)

All Other

All Publications (4 results)

  • [Publications] K. SEKINE, G. -M. CHOI, M. MORITA and T. OHMI: "Native Oxide Growing Behavior on Si Crystal Structure and Resistivity" Extended Abstracts of the 1996 International Conference on Solid State Devices and Materials. 166-168 (1996)

    • Related Report
      1996 Annual Research Report
  • [Publications] M. Morita, K. Sekine, and T. Ohmi: "Charging Control in X-ray Photoelectron Spectroscopy by Xe Lamp Light Irradiation to Very Thin SiO_2/Si Interfaces" ABSTRACTS and INFORMATIONS, Second International Symposium on Control of Semiconductor Interfaces. 67-67 (1996)

    • Related Report
      1996 Annual Research Report
  • [Publications] T. Ushiki, M. C. Yu, Y. Hirano, H. Shimada, M. Morita, and T. Ohmi: "Reliable Tantalum Gate Fully-Depleted-SOIMOSFET's with 0.15μm Gate Length by Low-Temperature Processing below 500℃" TECHNICAL DIGEST, THE IEEE INTERNATIONAL ELECTRON DEVICE MEETING. 117-120 (1996)

    • Related Report
      1996 Annual Research Report
  • [Publications] T. Iwamoto, M. Morita, and T. Ohmi: "Highly-Reliable Ultra Thin Gate Oxide Formation Process" TECHNICAL DIGEST, THE IEEE INTERNATIONAL ELECTRON DEVICE MEETING. 751-754 (1996)

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      1996 Annual Research Report

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Published: 1996-04-01   Modified: 2016-04-21  

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