再構成型機能装置付き計算機のためのプログラミング支援ツールに関する研究
| Project/Area Number |
08780298
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| Research Category |
Grant-in-Aid for Encouragement of Young Scientists (A)
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| Allocation Type | Single-year Grants |
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| Research Field |
計算機科学
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| Research Institution | Kyushu Institute of Technology |
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Principal Investigator |
久我 守弘 九州工業大学, マイクロ化総合技術センター, 講師 (80243989)
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| Project Period (FY) |
1996
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| Project Status |
Completed (Fiscal Year 1996)
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| Budget Amount *help |
¥900,000 (Direct Cost: ¥900,000)
Fiscal Year 1996: ¥900,000 (Direct Cost: ¥900,000)
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| Keywords | Reconfigurable Computing System / 回路分割 / 論理エミュレータ / FPGA |
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| Research Abstract |
研究実施計画にしたがい,「再構成型機能装置付き計算機のためのプログラミング支援ツールに関する研究」を行った.主な研究成果を以下に示す.
計算機の構成要素である機能装置(主に演算装置)の構成を構成情報のみ変えることで任意の機能を実現できる再構成型機能装置付き計算機において,その性能を最大限に発揮させるためには通常の計算機システムにおけるコンパイラに相当するプログラミング支援が不可欠である.プログラミング支援には,大きく分けて二つの処理がある.ひとつは,プログラミング言語によって記述されたプログラムのデータおよび制御に関する依存関係や動的実行特性を解析し,ハードウェア化することで処理速度の向上に効果がある部分の抽出を行う処理.もうひとつは,ハードウェア資源情報を基にして機能装置のハードウェアを自動生成する処理である.これらの処理の多くは既存の技術を応用することで対処可能であるが、特に後者の処理で必要なハードウェア実装は動作検証の高速化を図ることが再構成型機能装置付き計算機のためのプログラミング支援ツールとして不可欠となっている.
そこで,ハードウェア実装および動作検証の高速化のために必要な技術を重点的に検討した.具体的には,まずハードウェア記述言語で記述された様々な機能装置をハードウェア記述言語のレベルで解析し必要な論理回路要素に細分化を行う.さらに実装デバイスの規模や端子数を考慮して細分化した論理回路要素を複数個毎にまとめながら分割実装可能なグループに分ける処理を行う.この細分化とグループ化の処理を行う処理プログラムを作成し実際に評価を行ったところ,実装および動作検証の高速化を図れることが確認できた.このことから再構成型機能装置付き計算機のためのプログラミング支援ツールとして有効であることが見込まれる.
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Report
(1 results)
Research Products
(2 results)
