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次世代通信向けの超低消費電力のLDPC復号器研究開発

Research Project

Project/Area Number 11J03733
Research Category

Grant-in-Aid for JSPS Fellows

Allocation TypeSingle-year Grants
Section国内
Research Field Communication/Network engineering
Research InstitutionWaseda University

Principal Investigator

陳 志翔  早稲田大学, 情報生産システム研究科, 特別研究員(PD)

Project Period (FY) 2011 – 2012
Project Status Completed (Fiscal Year 2012)
Budget Amount *help
¥1,300,000 (Direct Cost: ¥1,300,000)
Fiscal Year 2012: ¥600,000 (Direct Cost: ¥600,000)
Fiscal Year 2011: ¥700,000 (Direct Cost: ¥700,000)
KeywordsLDPC decoder / Low power / VLSI / IEEE802.16e/WiMAX / IEEE802.15.3c/WPAN
Research Abstract

低消費電力低密度パリティ検査(LDPC)IEEE802.15.3cPHYをするためのコードデコーダLSI(WPAN)に関する研究
重要度:IEEE802.15.3cPHYをまたはWPANは、ギガビットワイヤレス通信をサポートする最先端の通信規格です。携帯端末装置用の低電力LDPCデコーダLSIが必要となります。
我々は、パリティ検査行列構造の探査に基づいて、メッセージ置換方式を提案する。結果、メッセージ・パッシング・ネットワークは、純粋な線を含まなく論理回路の実装を備えていません。従来構造と比較して、グローバルなゲート数40%の電力の35%が原因で提案アイデアの導入にそれぞれ削減されます。
この作品は第18回アジア南太平洋設計自動化会議設計競争で発表されていました。
IEEE802.16e規格におけるLDPC符号復号器LSIに関する研究(WiMAXの)
重要度:IEEE802.16e規格やWiMAXは、特にデータ転送速度の長期的に高品質な無線通信を提供する有望な無線通信規格です。しかし、WiMAXのに含まれているLDPCデコーダの高い消費電力が将来のアプリケーションのボトルネックになっている。したがって、低電力LDPCデコーダLSIの研究は間違いなく重要と有意義です。
我々は、WiMAXアプリケーションのためのビットシリアル完全に並列復号を用いた高エネルギー効率LDPCデコーダアーキテクチャを提案する。それは、事前に列の置換技術を使用して、2つの行の同時デコードを提供しています。メッセージの相互結合網の複雑さは飛躍的にビットシリアルメッセージパッシングのアイデアを導入することにより低減されます。
この作品は、2012年IEICE論文誌で発表されていました。

Report

(2 results)
  • 2012 Annual Research Report
  • 2011 Annual Research Report
  • Research Products

    (6 results)

All 2013 2012 2011

All Journal Article (3 results) (of which Peer Reviewed: 3 results) Presentation (3 results)

  • [Journal Article] High-performance H.264/AVC intra prediction architecture for Ultra-HD video applications2013

    • Author(s)
      Gang He, Dajiang Zhou, Wei Fei, Zhixiang Chen, Jinjia Zhou, and Satoshi Goto
    • Journal Title

      IEEE Transactions on Very Large Scale IntegrationSystem

      Volume: 99 Issue: 1 Pages: 1-14

    • DOI

      10.1109/tvlsi.2012.2235090

    • Related Report
      2012 Annual Research Report
    • Peer Reviewed
  • [Journal Article] An 115mW 1Gbps Bit-Serial Layered LDPC Decoder for WiMAX2012

    • Author(s)
      Xiongxin Zhao, Xiao Peng, Zhixiang Chen, Dajiang Zhou and Satoshi Goto
    • Journal Title

      IEICE Transactions. on Fundamentals : Special Section on VLSI Design and CAD Algorithms

      Volume: E95-A Pages: 1745-1337

    • Related Report
      2012 Annual Research Report
    • Peer Reviewed
  • [Journal Article] A 6.72-Gb/s 8pJ/bit/iteration IEEE 802.15.3c LDPC Decoder Chip2011

    • Author(s)
      Zhixiang CHEN, Xiao PENG, Xiongxin ZHAO, Leona OKAMURA, Dajiang ZHOU, Satoshi GOTO
    • Journal Title

      IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences

      Volume: E94-A Issue: 12 Pages: 2587-2596

    • DOI

      10.1587/transfun.E94.A.2587

    • NAID

      10030533698

    • ISSN
      0916-8508, 1745-1337
    • Related Report
      2011 Annual Research Report
    • Peer Reviewed
  • [Presentation] DVB-T2 LDPC Decoder with Perfect Conflict Resolution2013

    • Author(s)
      Xiongxin ZHAO, Zhixiang CHEN, Xiao PENG, Dajiang ZHOU and Satoshi GOTO
    • Organizer
      9^<th> International Symposium on VLSI Design, Automation and Test (VLSI-DAT 2013)
    • Place of Presentation
      Hsingchu, Taiwan
    • Year and Date
      2013-04-23
    • Related Report
      2012 Annual Research Report
  • [Presentation] A 6.72-Gb/s, 8pJ/bit/iteration WPAN LDPC Decoder in 65nm CMOS2013

    • Author(s)
      Zhixiang CHEN, Xiao PENG, Xiongxin ZHAO, Leona OKAMURA, Dajiang ZHOU, Satoshi GOTO
    • Organizer
      18th Asia and South Pacific Design Automation Conference (ASP-DAC 2013)
    • Place of Presentation
      Yokohama, Japan
    • Year and Date
      2013-01-24
    • Related Report
      2012 Annual Research Report
  • [Presentation] A macro-layer level fully parallel layered LDPC decoder SoC for IEEE 802.15.3c application2011

    • Author(s)
      Zhixiang CHEN, Xiao PENG, Xiongxin ZHAO, Qian XIE, Leona OKAMURA, Dajiang ZHOU, Satoshi GOTO
    • Organizer
      International Symposium on VLSI Design, Automation and Test
    • Place of Presentation
      Hsinchu, Taiwan
    • Year and Date
      2011-04-23
    • Related Report
      2011 Annual Research Report

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Published: 2011-12-12   Modified: 2024-03-26  

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