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多値論理基本関数を実現するための電圧モード多値論理VLSIチップの試作と評価

Research Project

Project/Area Number 17760328
Research Category

Grant-in-Aid for Young Scientists (B)

Allocation TypeSingle-year Grants
Research Field System engineering
Research InstitutionTsukuba University of Technology

Principal Investigator

稲葉 基  Tsukuba University of Technology, 産業技術学部, 准教授 (80352566)

Project Period (FY) 2005 – 2007
Project Status Completed (Fiscal Year 2007)
Budget Amount *help
¥3,500,000 (Direct Cost: ¥3,500,000)
Fiscal Year 2007: ¥500,000 (Direct Cost: ¥500,000)
Fiscal Year 2006: ¥800,000 (Direct Cost: ¥800,000)
Fiscal Year 2005: ¥2,200,000 (Direct Cost: ¥2,200,000)
Keywords多値論理 / VLSI工学 / ニューロンMOSFET / VLSIチップ / ダウンリテラル回路 / アナログインバータ / FG-MOSFET
Research Abstract

本研究最終年度となる平成19年度は,前年度までにトランジスタレベル・レイアウトをおこない,東京大学大規模集積システム設計教育研究センター(VDEC)のVLSI試作サービスで製作・パッケージングされた多値論理VLSIチップの評価ならびに成果発表をおこなった.
多値論理は,3つ以上の論理レベルで情報を処理する論理で,現行の2値論理システムの配線占有面積や消費電力といった問題を打開する手法の1つとして注目されている.試作チップには,ニューロンMOSFETを2個ずつ用いて構成できるダウンリテラル回路とアナログインバータ,そしてこれらの応用回路である電圧比較器,多値パスゲート,Tゲート等を搭載した.多値論理信号処理のための基本関数を実現するだけでなく,標準的なCMOSダブルポリシリコンプロセスで製作できることも,これらの回路の大きな長所である.それぞれの試作チップごとに専用のテストベンチの開発し,温度管理のもと,各回路の直流特性,交流特性,クロストーク等の詳細な評価をおこなった.フローティング・ゲート上の初期電荷によって若干のばらつきはあるものの,およそ9割の試作回路で,16個以上の論理レベルによる電圧モード多値論理信号処理を続けられるだけのノイズマージンと線形な可変しきい値特性が確認された.
また,前年度の段階でデータ解析が終わっていた実験結果に関しては,国際シンポジウム(第37回ISMVL)へ論文投稿し,査読を経て,5月にオスロで発表ならびに関連分野の研究者・技術者との意見交換をおこなった.

Report

(3 results)
  • 2007 Annual Research Report
  • 2006 Annual Research Report
  • 2005 Annual Research Report
  • Research Products

    (1 results)

All 2007

All Journal Article (1 results) (of which Peer Reviewed: 1 results)

  • [Journal Article] Experiment Result of Down Literal Circuit and Analog Inverter on CMOS Double-Polysilicon Process2007

    • Author(s)
      Motoi INABA
    • Journal Title

      Proceedings of 37th IEEE International Symposium on Multiple-Valued Logic

      Pages: 58-58

    • Related Report
      2007 Annual Research Report
    • Peer Reviewed

URL: 

Published: 2005-04-01   Modified: 2016-04-21  

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