Study on Hardware-Software Collaborative Scheduling for Highly Efficient Multithreading
| Project/Area Number |
18300011
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| Research Category |
Grant-in-Aid for Scientific Research (B)
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| Allocation Type | Single-year Grants |
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| Section | 一般 |
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| Research Field |
Computer system/Network
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| Research Institution | Tohoku University |
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Principal Investigator |
KOBAYASHI Hiroaki Tohoku University, サイバ-サイエンスセンタ-, 教授 (40205480)
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| Co-Investigator(Kenkyū-buntansha) |
中村 維男 東北大学, 名誉教授 (80005454)
鈴木 健一 東北大学, 大学院・情報科学研究科, 講師 (50300520)
滝沢 寛之 東北大学, 大学院・情報科学研究科, 講師 (70323996)
江川 隆輔 東北大学, 情報シナジー機構, 助教 (80374990)
佐藤 幸紀 北陸先端科学技術大学院大学, 情報科学センター, 助教 (30452113)
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| Co-Investigator(Renkei-kenkyūsha) |
NAKAMURA Tadao 東北大学, 名誉教授 (80005454)
SUZUKI Kenichi 東北工業大学, 情報通信工学科, 准教授 (50300520)
TAKIZAWA Hiroyuki 東北大学, 情報科学研究科, 准教授 (70323996)
EGAWA Ryusuke 東北大学, サイバーサイエンスセンター, 助教 (80374990)
SATO Yukinori 北陸先端科学技術大学院大学, 情報科学センター, 助教 (30452113)
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| Research Collaborator |
KOTERA Isao 株式会社, ルネサステクノロジ
FUNAYA Yusuke 東北大学, 大学院情報科学研究科, 博士課程後期
SATO Masayuki 東北大学, 大学院情報科学研究科, 博士課程後期
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| Project Period (FY) |
2006 – 2009
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| Project Status |
Completed (Fiscal Year 2008)
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| Budget Amount *help |
¥18,300,000 (Direct Cost: ¥15,300,000、Indirect Cost: ¥3,000,000)
Fiscal Year 2008: ¥6,890,000 (Direct Cost: ¥5,300,000、Indirect Cost: ¥1,590,000)
Fiscal Year 2007: ¥6,110,000 (Direct Cost: ¥4,700,000、Indirect Cost: ¥1,410,000)
Fiscal Year 2006: ¥5,300,000 (Direct Cost: ¥5,300,000)
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| Keywords | スレッドスケジューリング / マルチコアプロセッサ / 低消費電力機構 / キャッシュ / 消費電力最適化 / キヤッシュ / SMT / CMT / 共有キャッシュ分割 / フェアキャッシュスケジューリング / スレッド特微量 / 省電力プロセッサ設計 |
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| Research Abstract |
次世代のオンチップマルチコアプロセッサ(CMP)において、オンチップ計算資源の効率的活用による低消費電力高性能処理の実現を目指して、低消費電力指向高効率マルチスレッド処理技術の研究・開発を行った。具体的には、CMP上で実行されるスレッドの特徴量を定義し、この定義に基づくマルチコアプロセッサのための高効率スレッドスケジュ-リング手法を確立すると共に、高性能と低消費電力の両立を実現する動的キャッシュ分割機構を開発し、シミュレ-ションにより、その有効性を明らかにした。
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Report
(4 results)
Research Products
(55 results)
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[Journal Article] Future Design Strategy of Combinational Logic Circuits2006
Author(s)
Ryusuke Egawa, Tasuku Ito, Tomoyuki Inoue, Jubee Tada, Ken-ichi Suzuki and Tadao Nakamura
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Journal Title
Proceedings of The Fourth International Conference on Information, the Fourth Irish Conference on the Mathematical Foundations of Computer Science and Information Technology'06(Information MFCSIT'06)
Pages: 110-113
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Peer Reviewed
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[Journal Article] Future Design Strategy of Combinational Logic Circuits2006
Author(s)
Ryusuke Egawa, Tasku Ito, Tomoyuki Inoue, Jubei Tada, Ken-ichi Suzuki, Tadao Nakamura
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Journal Title
Proceedings of The Fourth International Conference on Information, the Fourth Irish Conference on the Mathematical Foundations of Computer Science and Information Technology' 06 (Information-MFCSIT'06)
Pages: 110-113
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