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カオス同期を活用した新ワイヤレス通信方式の研究

Research Project

Project/Area Number 19656093
Research Category

Grant-in-Aid for Exploratory Research

Allocation TypeSingle-year Grants
Research Field Communication/Network engineering
Research InstitutionHokkaido University

Principal Investigator

佐野 栄一  Hokkaido University, 量子集積エレクトロニクス研究センター, 教授 (10333650)

Co-Investigator(Kenkyū-buntansha) 池辺 将之  北海道大学, 大学院・情報科学研究科, 准教授 (20374613)
Project Period (FY) 2007 – 2008
Project Status Completed (Fiscal Year 2008)
Budget Amount *help
¥3,300,000 (Direct Cost: ¥3,300,000)
Fiscal Year 2008: ¥1,000,000 (Direct Cost: ¥1,000,000)
Fiscal Year 2007: ¥2,300,000 (Direct Cost: ¥2,300,000)
Keywordsカオス / ワイヤレス通信 / ネットワーク / プロトコル / 発振回路
Research Abstract

本研究は、自然現象や社会現象で普遍的に見られるカオス同期に学ぶことにより、カオス同期による端末クラスタの形成、クラスタのグラフ論的性質を理解し、クラスタを活用した経路探索プロトコルを考案することにより、これまでのワイヤレス通信システムに革新をもたらす新たな通信方式を創出することを目的とする。昨年度の研究成果を発展させる研究を行った1。(1)カオス発生器を有するノードを円内あるいは直線に沿ってランダムに配置し、カオス発生器としてChua回路、ローレンツ写像、レスラー写像を用いて数値シミュレーションを行った。その結果、近接したノード問のみで同期クラスタを形成するのではなく、飛び地ができるという現象が見つかった。この現象はノード間の位相に深く関係しているものと推定している。(2)同期クラスタ内の端末間で経路探索のための情報をやり取りすることにより、放送型プロトコルと比較して周波数資源効率の向上と経路探索処理の高速化が可能であるとの考え方に基づき、カオス信号を搬送キャリアとしたクラスタ内でのデータ通信が可能か検討した。その結果、Chua回路によるカオス信号をキャリアとした場合にデータ通信成功の確率が高いことを明らかにした。ただし、この場合には確率100%とは限らず、改善策を探る必要がある。(3)新たに考案した発振周期同期型PLLについて、CMOSを用いて試作・評価を行った結果、正常動作を確認し、所期の目的を達成した。また、クロック生成に必要な3分周回路を考案した。(4)Kuramoto発振器としてリング発振器間の注入同期現象をCMOS試作により検討し、二つの発振器間同期を確認した.

Report

(2 results)
  • 2008 Annual Research Report
  • 2007 Annual Research Report
  • Research Products

    (6 results)

All 2009 2008 2007

All Journal Article (3 results) (of which Peer Reviewed: 3 results) Presentation (3 results)

  • [Journal Article] The design of high frequency true single phase clocking divider-by-3 circuit2008

    • Author(s)
      M. Ikebe, Y.Takada, M.Ohuchi,J. Motohisa, and E. Sano
    • Journal Title

      Int. J. Circuits, Systems and Signal processing 2

      Pages: 219-228

    • Related Report
      2008 Annual Research Report
    • Peer Reviewed
  • [Journal Article] Evaluation of digitally controlled PLL by clock-period comparison2007

    • Author(s)
      Y. Makihara
    • Journal Title

      IEICE Trans. Electron. E-90-C

      Pages: 1307-1310

    • Related Report
      2007 Annual Research Report
    • Peer Reviewed
  • [Journal Article] Micromagnetic simulation of coupled magnetic oscillators driven by spin-transfer torque2007

    • Author(s)
      E. Sano
    • Journal Title

      Jpn. J. Appl. Phys. 46

    • NAID

      210000063801

    • Related Report
      2007 Annual Research Report
    • Peer Reviewed
  • [Presentation] Frequency and phase lock operation using clock-period comparator2009

    • Author(s)
      Y. Makihara
    • Organizer
      Intl. Symposium on Multimedia and Communication Technology
    • Place of Presentation
      Bangkok, Thailand
    • Year and Date
      2009-01-23
    • Related Report
      2008 Annual Research Report
  • [Presentation] A 0.18μm 3GHz true single phase clocking divider-by-3 circuit2008

    • Author(s)
      M. Ikebe
    • Organizer
      2008 WSEAS Intl. Conf. on Circuits, Systems, Electronics, Control & Signal Processing
    • Place of Presentation
      Tenerife, Canary Islands, Spain
    • Year and Date
      2008-12-16
    • Related Report
      2008 Annual Research Report
  • [Presentation] Phase lock operation by clock-period comparison for all digital PLL2008

    • Author(s)
      Y. Makihara
    • Organizer
      Intl. Symposium on Topical Problems of Nonlinear Wave Physics (NWP)
    • Place of Presentation
      Nizhnij Novgorod, Russia
    • Year and Date
      2008-07-21
    • Related Report
      2008 Annual Research Report

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Published: 2007-04-01   Modified: 2016-04-21  

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