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距離指定型命令セットアーキテクチャによる超高効率実行の実証

Research Project

Project/Area Number 23K19975
Research Category

Grant-in-Aid for Research Activity Start-up

Allocation TypeMulti-year Fund
Review Section 1001:Information science, computer engineering, and related fields
Research InstitutionNagoya Institute of Technology

Principal Investigator

小泉 透  名古屋工業大学, 工学(系)研究科(研究院), 助教 (20981525)

Project Period (FY) 2023-08-31 – 2025-03-31
Project Status Granted (Fiscal Year 2023)
Budget Amount *help
¥2,860,000 (Direct Cost: ¥2,200,000、Indirect Cost: ¥660,000)
Fiscal Year 2024: ¥1,430,000 (Direct Cost: ¥1,100,000、Indirect Cost: ¥330,000)
Fiscal Year 2023: ¥1,430,000 (Direct Cost: ¥1,100,000、Indirect Cost: ¥330,000)
Keywords計算機アーキテクチャ / 命令レベル並列性 / アウトオブオーダー実行 / 最適化コンパイラ
Outline of Research at the Start

距離指定型命令セットは、命令オペランドをレジスタ名ではなく「何回前にレジスタに書き込んだ値」のように距離で指定する命令セットの一群である。この方式は電力消費の激しいレジスタリネーミングが不要であり、従来型命令セットを超える高効率実行が可能となる。
本研究では、当該命令セット向けの最適化コンパイラをより発展させるとともに、当該命令セット向けにハードウェア機構を最適化する。また、実チップを作製することで電力効率の改善を実証する。

Outline of Annual Research Achievements

命令オペランドをレジスタ名ではなく「何回前にレジスタに書き込んだ値」のように距離で指定する命令セットを距離指定型命令セットと呼ぶ。
今年度は、距離指定型命令セットに分類され、我々が提案する新しい命令セット、Clockhandsについて研究を行った。まず、SPEC CPUベンチマークについて、Clockhands命令セットに変換する際の最適化に新たな手法を導入した。これにより、RISC-V命令セットに対する命令数増加を平均8.7%と一割未満に抑えることができた。次に、Clockhandsプロセッサの性能(プログラムの実行速度)をRISC-Vプロセッサの性能と比較した。その結果、同時フェッチ命令数が8のコンフィギュレーションでは99%、同時フェッチ命令数が16のコンフィギュレーションでは102%と、ほぼ同等の性能を達成できることが判明した。さらに、消費エネルギーの評価を行った。評価の結果、ClockhandsプロセッサはRISC-Vプロセッサに対して、同時フェッチ命令数が8のコンフィギュレーションでは8%、同時フェッチ命令数が16のコンフィギュレーションでは32%、消費エネルギーを削減できると判明した。

結論としては、Clockhands命令セットは、命令セットに新機能を搭載しなくとも、(1)命令数増加オーバーヘッドはそれほど大きくなく、(2)性能はほぼ同等レベルを達成可能であり、(3)消費エネルギーを削減可能であり、(4)特にフェッチ幅が大きい時に消費エネルギー削減効果が高い、の四点に要約される。

Current Status of Research Progress
Current Status of Research Progress

1: Research has progressed more than it was originally planned.

Reason

2024年度に実施予定だった作業を一部前倒しすることができたため。

当初の計画では、ハードウェアアルゴリズムの改良と命令セットへの新たな機能の追加が、命令当たりにかかる消費エネルギーの削減に必須であると考え、それに関する作業を行う必要があるとしていた。しかし、実際にはそのようなことを行わなくても、コンパイラアルゴリズムの改良のみで十分に消費エネルギーを削減できることが判明した。これにより、作業時間が浮いたため、ソフトコアの実装を洗練させる作業に充てることができた。

Strategy for Future Research Activity

引き続き、ソフトコアの実装を洗練させ、試作チップのテープアウトに力を注ぐ。2024年度第二回チップ試作に間に合うように作業し、問題が発生したとしても第三回チップ試作には絶対に間に合うように作業する。テープアウト後はプログラムの高度な最適化を行えるようにし、試作チップでの高速なプログラム動作を補助できるようにする。
試作チップでの評価が取れ次第、論文を執筆し、投稿する。

Report

(1 results)
  • 2023 Research-status Report
  • Research Products

    (2 results)

All 2023

All Presentation (2 results) (of which Int'l Joint Research: 1 results,  Invited: 1 results)

  • [Presentation] Clockhands: Rename-free Instruction Set Architecture for Out-of-order Processors2023

    • Author(s)
      Toru Koizumi
    • Organizer
      The 56th Annual IEEE/ACM International Symposium on Microarchitecture
    • Related Report
      2023 Research-status Report
    • Int'l Joint Research
  • [Presentation] 距離指定型命令セットによる省電力高性能プロセッサの実現2023

    • Author(s)
      小泉 透
    • Organizer
      第13回メニーコア・アーキテクチャ研究会
    • Related Report
      2023 Research-status Report
    • Invited

URL: 

Published: 2023-09-11   Modified: 2024-12-25  

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