ＳＥＴ耐性強化カスケード電圧スイッチ論理回路組み込み宇宙用ＬＳＩの開発研究
| Project/Area Number |
26420324
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| Research Category |
Grant-in-Aid for Scientific Research (C)
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| Allocation Type | Multi-year Fund |
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| Section | 一般 |
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| Research Field |
Electron device/Electronic equipment
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| Research Institution | Shizuoka Institute of Science and Technology |
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Principal Investigator |
波多野 裕 静岡理工科大学, 理工学部, 教授 (80238013)
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| Project Period (FY) |
2014-04-01 – 2017-03-31
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| Project Status |
Discontinued (Fiscal Year 2016)
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| Budget Amount *help |
¥4,810,000 (Direct Cost: ¥3,700,000、Indirect Cost: ¥1,110,000)
Fiscal Year 2017: ¥260,000 (Direct Cost: ¥200,000、Indirect Cost: ¥60,000)
Fiscal Year 2016: ¥650,000 (Direct Cost: ¥500,000、Indirect Cost: ¥150,000)
Fiscal Year 2015: ¥1,820,000 (Direct Cost: ¥1,400,000、Indirect Cost: ¥420,000)
Fiscal Year 2014: ¥2,080,000 (Direct Cost: ¥1,600,000、Indirect Cost: ¥480,000)
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| Keywords | 電子デバイス・機器 / 回路設計 / 放射線、粒子線 / 宇宙線 / シミュレーション / ＣＶＳＬ / 変換アルゴリズム / ＳＥＴシミュレーション / ＣＭＯＳ / トランジスタ寸法最適化 |
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| Outline of Annual Research Achievements |
宇宙用耐放射線システムＬＳＩの実現を目指して、チップ試作により動作確認に成功したスタティック形カスケード電圧スイッチ論理（ＣＶＳＬ）回路と研究代表者が新規に提案したクロック形ＣＶＳＬ（Ｃ２ＶＳＬ）回路に対してＳＥＴシミュレーションを行った。電源電圧1.8Ｖの0.18μm 技術において、スタティック型ＣＶＳＬ回路は宇宙応用に対して十分な耐性があることが判明した。
次に、1ビットＣＭＯＳコンパレータ、2ビットＣＭＯＳコンパレータ、4レベルＣＭＯＳプライオリティ・エンコーダ回路、ＣＭＯＳマスター・スレーブ型ＪＫフリップフロップ、ポジティブ・エッジトリガ型ＪＫフリップフロップ、ポジティブ・エッジトリガ型Ｄフリップフロップに関して、ＳＥＴ耐性強化の観点から、トランジスタ・パラメータの設計最適化を検討した。ゲート幅Ｗの拡大により、ＣＭＯＳ回路にも宇宙応用に対して解があることが判明した。
更に、ニューロンＭＯＳ回路に対する宇宙空間における荷電粒子の影響は通常のＣＭＯＳ回路と同程度であると考えられるということが判明した。
以上、ＣＶＳＬ回路、ＣＭＯＳ回路およびニューロンＭＯＳ回路を用いたＳＥＴ耐性強化宇宙用ＬＳＩに関する総まとめを行った。0.18μm ＣＭＯＳ技術を対象に、回路試作、ＳＥＴシミュレーションなどにより検討を行ってきた内容をまとめたが、更に当該研究を発展させるためには、0.1μm以下の微細回路に関する研究が期待される。また、ＳＥＴ耐性の検討のためには、荷電粒子照射実験による実証や実際の宇宙空間における実験が有効であると考えられる。
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Report
(3 results)
Research Products
(1 results)
