2014 Fiscal Year Annual Research Report
アジャイル・低電力プラットフォーム向けソフトウェア無線回路技術の研究
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14J03929
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| Research Institution | The University of Tokyo |
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Principal Investigator |
井口 俊太 東京大学, 工学系研究科, 特別研究員(DC2)
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2014-04-25 – 2016-03-31
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| Keywords | アジャイル・低電力プラットフォーム / 水晶発振回路 / 高速起動 |
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| Outline of Annual Research Achievements |
2014年度は、「スイッチトキャパシタ回路」「コンパレータ」「低速アンプ」で実現可能な機能及び性能の理論限界をMatlabによるシステムレベルでのシミュレーションによって検証し、受信感度を維持したまま様々な変調方式に対応するためにはサンプリング回路の制御信号のジッターを±0.54ns 以下に抑える必要があることを明らかにした。制御信号のジッターは周波数生成回路(Ex. 水晶発振回路やPLL)の位相ノイズによって決定されるので、低ジッターな制御信号を作るには低ノイズな水晶発振回路の実現が必須である。また、アジャイル・低電力プラットフォームでは回路を間欠動作させることで消費電力の削減を行うことを予定しているので、高頻度な間欠動作のために高速起動可能な水晶発振回路の実現が必須である。このような背景から、高速起動可能かつ低ノイズな水晶発振回路の設計及び試作を行い、IEEE Symposium on VLSI Circuits 2014で報告を行った。本研究では、立ち上がり時にノイズを水晶発振回路に注入し、水晶にエネルギーを充電することによって水晶発振回路の起動時間を削減した。注入するノイズはチャープ変調されており、トランジスタの性能が温度や電源電圧によって変動しても常に高速かつ安定した起動特性を実現することができる。また、起動時のみ動作する負性抵抗ブースタを定常状態で用いるインバータと並列に挿入することで、更なる起動高速化を実現した。提案のチャープ変調ノイズ注入及び負性抵抗ブースタを用いた水晶発振回路は起動時間が2.1msから0.16msに短縮され、起動時間を92%高速化することができた。
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| Current Status of Research Progress |
Current Status of Research Progress
2: Research has progressed on the whole more than it was originally planned.
Reason
2014年度は、年次計画で計画していたように「スイッチトキャパシタ回路」「コンパレータ」「低速アンプ」で実現可能な機能及び性能の理論限界をMatlabによるシステムレベルでのシミュレーションによって検証し、受信感度を維持したまま様々な変調方式に対応するためにはサンプリング回路の制御信号のジッターを±0.54ns 以下に抑える必要があることを明らかにした。検討の結果、水晶発振回路の起動時間が全体のシステム性能を大きく左右することが明らかになったので、低ノイズかつ高速起動可能な水晶発振回路の設計及び試作を行った。本研究で報告した水晶発振回路では、プロセスバラつきや温度変動、電源電圧変動が存在しても起動時間のバラつきを13%以下に抑えることができた。起動時間も2.1msから0.16msに短縮され、起動時間を92%高速化することができた。また、提案した水晶発振回路の位相ノイズは1kHzオフセットの時に-147dBc/Hzと非常に小さく、先行研究と比較しても非常に低ノイズな水晶発振回路を実現することができた。本提案技術により「アジャイル・低電力プラットフォーム」で実現される無線センサノードは間欠動作比を大きくすることができ、超低消費電力化が実現できると期待される。また、提案した水晶発振回路が生成する低ノイズ及び低ジッターな制御信号により、受信感度を維持したまま様々な変調方式に対応することが可能になる。このように、本研究課題は当初研究目的どおりにおおむね順調に進展していると考えている。
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| Strategy for Future Research Activity |
今後は、当初の年次計画にあるようにこれまで検討してきた個別回路を組み合わせることで無線回路の評価を進める予定である。それぞれの回路を組み合わせる際の影響を考慮しながら評価を行う予定であるが、インピーダンスマッチングやレベルシフトなどの必要性を考慮し、問題があれば個別回路の再設計を行う予定である。また、水晶発振回路の起動時間の更なる高速化によるシステム全体の性能向上も進捗状況に応じて行う予定である。2014年度は、本研究課題に関する研究成果の一部をIEEE Symposium on VLSI Circuits 2014や電子情報通信学会で報告した[1], [2]が、今後も国際会議や論文誌への投稿を通じて本研究による成果を社会のために還元していきたいと考えている。
参考文献
[1] S. Iguchi, H. Fuketa, T. Sakurai, and M. Takamiya, “92% Start-up time reduction by variation-tolerant chirp injection (CI) and negative resistance booster (NRB) in 39 MHz crystal oscillator,” in IEEE Symp. VLSI Circuits Dig. Tech. Papers, Jun. 2014, pp. 236-237.
[2] 井口 俊太, 更田 裕司, 桜井 貴康, 高宮 真, “チャープ変調励振信号と負性抵抗ブースタによる39MHz水晶発振回路の起動時間の高速化,” 電子情報通信学会, 信学技報, ICD2014-28, pp. 81-86, 2014年7月.
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