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2018 Fiscal Year Research-status Report

測定型量子回路の設計理論の構築

Research Project

Project/Area Number 18K19790
Research InstitutionRitsumeikan University

Principal Investigator

山下 茂  立命館大学, 情報理工学部, 教授 (30362833)

Project Period (FY) 2018-06-29 – 2021-03-31
Keywords測定型量子回路 / トポロジカル量子回路 / bridge / トーラス
Outline of Annual Research Achievements

量子計算を実現する方式として,測定型量子回路を用いる方式がエラー耐性を考慮すると最も実現可能性が高いと考えられている.そのため,測定型量子回路の設計最適化について新たな設計理論の構築を目指している.今年度は,測定型量子回路として,特に,トポロジカル量子回路を取り上げて,その最適化手法に関して,従来にない手法の検討を行った.トポロジカル量子回路の最適化としては,最適化のための様々な変形規則が提案されているが,その変形規則を用いた最適化は現在人手によって実現されている.そこで,回路をトーラスの集合で表現して変形規則のbridgeを定式化し,計算機上でトーラスの交差数に注目したトポロジカル量子回路の最適化を行うための手法を考案した.考案した手法では,トポロジカル量子回路を構成するトーラスの順序を並べ替え,bridgeを適用することによって,トーラスの交差数が最小なトポロジカル量子回路を見つけることを基本としている.提案手法では,まず,トポロジー的な連続変形のみでトポロジカル量子回路の回路コストを削減する.その後,削減できた回路のトーラスの順序を並べ替え,2つのトーラス間でbridgeを適用できるかを判断することで,bridgeも含めたトーラスの交差数の削減を実現する.計算機シミュレーション実験の結果,bridgeを用いた変形を自動化することによって,手動による手法と同等の結果を全自動で得られることを確認した.そのため,人手では最適化できない大規模な回路でも今後は自動で最適化できるようになると期待できる.

Current Status of Research Progress
Current Status of Research Progress

2: Research has progressed on the whole more than it was originally planned.

Reason

研究目標としている,測定型量子回路の最適化に関して,測定型量子回路の一つのタイプであるトポロジカル量子回路の最適化の新しい定式化を考案して,最適化プログラムに利用可能であることを確認できたため.

Strategy for Future Research Activity

測定型量子回路として,当初は,トポロジカル量子回路を対象に考えて研究をすすめる計画であった.しかし,近年,提案された別の方式である,「lattice surgery」と呼ばれる方式が殆どの場合でより実現コストが小さいという報告があり,今後は,lattice surgeryの方式も検討することとする.

Causes of Carryover

論文誌の印刷代などの支払処理が次年度にずれ込んだだめ.

  • Research Products

    (8 results)

All 2019 2018

All Journal Article (5 results) (of which Peer Reviewed: 4 results) Presentation (3 results) (of which Int'l Joint Research: 3 results)

  • [Journal Article] Compaction of Topological Quantum Circuits by Modularization2019

    • Author(s)
      Kota Asahi and Shigeru Yamashita
    • Journal Title

      IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences

      Volume: Vol.E102-A, No.4 Pages: 624~632

    • DOI

      10.1587/transfun.E102.A.624

    • Peer Reviewed
  • [Journal Article] 大規模TQEC回路の自動最適化手法2019

    • Author(s)
      浅井孝太, 星孝太郎, 山下茂
    • Journal Title

      電子情報通信学会論文誌D

      Volume: Vol.J102-D, No.5 Pages: 367~377

    • DOI

      10.14923/transinfj.2018JDP7040

    • Peer Reviewed
  • [Journal Article] Exact Synthesis of Nearest Neighbor Compliant Quantum Circuits in 2D architecture and its Application to Large-scale Circuits2019

    • Author(s)
      Jingwen Ding and Shigeru Yamashita
    • Journal Title

      IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems

      Volume: 1 Pages: 1

    • DOI

      10.1109/TCAD.2019.2907919

    • Peer Reviewed
  • [Journal Article] Quantum Circuit Optimization by Changing the Gate Order for 2D Nearest Neighbor Architectures2018

    • Author(s)
      Wakaki Hattori and Shigeru Yamashita
    • Journal Title

      Lecture Notes in Computer Science

      Volume: 11106 Pages: 228~243

    • DOI

      10.1007/978-3-319-99498-7_16

    • Peer Reviewed
  • [Journal Article] 量子回路設計と最適化2018

    • Author(s)
      山下茂,松尾惇士
    • Journal Title

      オペレーションズ・リサーチ

      Volume: Vol.63, No.6 Pages: 342~349

  • [Presentation] Exact and Approximate Exact Synthesis of Nearest Neighbor Compliant Quantum Circuits in 2-D Architectures2018

    • Author(s)
      Jingwen Ding
    • Organizer
      AQIS 2018
    • Int'l Joint Research
  • [Presentation] Compaction of Topological Quantum Circuits by Modularization2018

    • Author(s)
      Kota Asai and Shigeru Yamashita
    • Organizer
      AQIS 2018
    • Int'l Joint Research
  • [Presentation] Mapping to 2D Nearest Neighbor Architecture by a SAT Solver and A* Algorithm2018

    • Author(s)
      Wakaki Hattori and Shigeru Yamashita
    • Organizer
      AQIS 2018
    • Int'l Joint Research

URL: 

Published: 2019-12-27  

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