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2020 Fiscal Year Research-status Report

Preventive safety for VLSIs Based on Adaptive Test during Field Operation

Research Project

Project/Area Number 18KT0014
Research InstitutionKyushu Institute of Technology

Principal Investigator

梶原 誠司  九州工業大学, 大学院情報工学研究院, 教授 (80252592)

Co-Investigator(Kenkyū-buntansha) 大竹 哲史  大分大学, 理工学部, 教授 (20314528)
三宅 庸資  九州工業大学, 大学院情報工学研究院, 研究職員 (60793403)
Project Period (FY) 2018-07-18 – 2022-03-31
Keywordsフィールド高信頼化 / VLSIテスト / データマイニング / 組込み自己テスト / 予防安全
Outline of Annual Research Achievements

本研究では、フィールド運用中のVLSIの自己テストで得られる、故障した際の使用環境や遅延マージン等の情報を解析することにより運用中のVLSIの状態を把握し、劣化の検知や故障解析、予防安全に活用していく手法の開発を目的とする。 (1)テスト履歴データの作成・取得方法の確立 (2)テスト履歴解析に基づく一時故障の弁別と劣化予測手法の開発 (3)アダプティブテスト履歴作成最適化手法の開発等の研究課題を解決することにより、劣化故障による誤動作を未然に効率良く防止できるようになり、現在は十分に実現できていないVLSIの予防安全を達成する。
本年度の研究は、テスト履歴解析に基づく劣化予測手法の開発に特に注力した。代表的な劣化現象である回路遅延の増加を自己テストに基づいたオンチップ遅延測定によって捕らえ、将来の回路遅延の劣化度合いを予測する手法を提案した。提案手法では、劣化シミュレーションや長期信頼性試験、代表チップを用いた予備実験で得られる回路遅延値から初期の予測モデルを作成し、個々のチップに対して実際の測定値に基づくオフセット補正及び勾配降下法を用いた動的なモデル更新により、製造ばらつきや運用状況の差異を反映した劣化予測を行う。180nm CMOSテクノロジで試作したチップに対する劣化加速試験のデータを用いた評価実験では、オフセット補正により予測誤差を86ps(回路遅延値の0.89%)に、さらにテスト履歴に基づいたアダプティブなモデル更新により誤差を45ps(回路遅延値の0.47%)にできることを示した。これらの結果から、提案手法は、製造ばらつきや運用状況の差異による劣化傾向の変化に対応した遅延劣化の予測モデルに有効であることを示した。

Current Status of Research Progress
Current Status of Research Progress

3: Progress in research has been slightly delayed.

Reason

これまでに、テスト履歴データの作成方法の確立、および、テスト履歴データ取得・活用方法の確立は終了し、九州工業大学で設計開発したチップの試作も終えて、劣化加速試験を含む各種データを取得すると同時に、テスト履歴解析に基づく劣化予測やアダプティブテスト履歴作成の開発を行った。共同研究者の大分大学では、新型コロナウィルス感染症対策のための在宅での研究開発によりチップ開発環境や測定装置を使用した研究に遅れがでた他、学会の中止等により学会発表や論文投稿にやや遅れがでている。

Strategy for Future Research Activity

これまで得られた知見をまとめて学会発表や論文投稿を推進する。特にテスト履歴解析に基づく劣化予測手法は、実チップでのデータも揃っており、トップレベルジャーナルへの論文投稿を検討する。開発した手法は、ASIC/SoCのみならずFPGAにも適用可能であるので、在宅勤務でも実施が容易なFPGAを対象とした実験・評価も推進する。

Causes of Carryover

新型コロナウイルスの影響により,参加を予定していた国内外の学会や研究会などの中止や延期が多発し,出張を伴う研究打ち合わせも実施することができなかった.
さらに,緊急事態宣言による外出自粛や大学への入構禁止等により,実験機器を利用する研究にも遅れが生じ,見積もっていた実験機器のライセンス使用料などが計画通りの予算執行を行うことができず,研究期間の延長に伴い,予算を次年度使用することとなった.
次年度の使用計画として,新型コロナウイルスの影響が未だ未知数のため,旅費としての使用見込みが立たず,主に延長した期間の人件費や,今年度使用できなかった実験機器のライセンス使用料等に使用予定である.

  • Research Products

    (9 results)

All 2021 2020 Other

All Int'l Joint Research (1 results) Journal Article (4 results) (of which Int'l Joint Research: 3 results,  Peer Reviewed: 3 results) Presentation (4 results) (of which Int'l Joint Research: 1 results)

  • [Int'l Joint Research] National Taiwan Univ. of Sci. and Tech.(その他の国・地域)

    • Country Name
      その他の国・地域
    • Counterpart Institution
      National Taiwan Univ. of Sci. and Tech.
  • [Journal Article] High Precision PLL Delay Matrix with Overclocking and Double Data Rate for Accurate FPGA Time-to-Digital Converter2020

    • Author(s)
      Poki Chen, Jian-Ting Lan, Ray-Ting Wang, Nguyen My Qui, Yousuke Miyake and Seiji Kajihara
    • Journal Title

      IEEE Transactions on Very Large Scale Integration Systems

      Volume: Volume: 28, Issue: 4 Pages: 904 - 913

    • DOI

      10.1109/tvlsi.2019.2962606

    • Peer Reviewed / Int'l Joint Research
  • [Journal Article] On-Chip Delay Measurement for Degradation Detection And Its Evaluation under Accelerated Life Test2020

    • Author(s)
      Yousuke Miyake, Takaaki Kato, Seiji KAJIHARA, Masao ASO, Haruji FUTAMI, Satoshi MATSUNAGA, Yukiya MIURA,
    • Journal Title

      IEEE International Symposium on On-Line Testing and Robust System Design, On-line symposium

      Volume: - Pages: 1-6

    • DOI

      10.1109/IOLTS50870.2020.9159717

    • Peer Reviewed / Int'l Joint Research
  • [Journal Article] Path Delay Measurement with Correction for Temperature and Voltage Variations2020

    • Author(s)
      Yousuke Miyake,Takaaki Kato, Seiji KAJIHARA
    • Journal Title

      IEEE International Test Conference in Asia

      Volume: - Pages: 112-117

    • DOI

      10.1109/ITC-Asia51099.2020.00031

  • [Journal Article] On Evaluation for Aging-Tolerant Ring Oscillators with Accelerated Life Test And Its Application to A Digital Sensor2020

    • Author(s)
      Masayuki Gondo, Yousuke Miyake, Takaaki Kato, Seiji Kajihara
    • Journal Title

      Proc. IEEE Asian Test Symposium

      Volume: - Pages: 1-6

    • DOI

      10.1109/ATS49688.2020.9301588

    • Peer Reviewed / Int'l Joint Research
  • [Presentation] メモリのサイズおよび形状に起因するロジック部の高消費電力エリア特定に関する研究2021

    • Author(s)
      高藤大輝, 星野 龍, 宮瀬紘平, 温 暁青, 梶原誠司
    • Organizer
      電子情報通信学会DC研究会
  • [Presentation] 勾配降下法を用いた回路遅延の劣化予測について2020

    • Author(s)
      森誠一郎, 権藤昌之, 三宅庸資, 加藤隆明, 梶原誠司
    • Organizer
      電子情報通信学会DC研究会
  • [Presentation] Innovative Test Practices in Asia2020

    • Author(s)
      T. Iwasaki, M. Aso, H. Futami, S. Matsunaga, Y. Miyake, T. Kato, S. Kajihara, Y. Miura, S. Lai, G. Hung, H.H. Chen, H. Kobayashi, K. Hatayama
    • Organizer
      IEEE VLSI Test Symposium
    • Int'l Joint Research
  • [Presentation] LSIの領域毎の信号値遷移確率に基づく電力評価に関する研究2020

    • Author(s)
      大庭 涼, 星野 竜, 宮瀬紘平, 温 暁青, 梶原誠司
    • Organizer
      電子情報通信学会DC研究会

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Published: 2021-12-27  

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