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2012 Fiscal Year Annual Research Report

True Scalable Si CMOS LSIの研究

Research Project

Project/Area Number 21246056
Research InstitutionTokyo Institute of Technology

Principal Investigator

益 一哉  東京工業大学, ソリューション研究機構, 教授 (20157192)

Project Period (FY) 2009-05-11 – 2013-03-31
Keywords集積回路 / CMOS / スケーリング / シリコン
Research Abstract

Si CMOS集積回路I高性能化の指針は、スケーリング則を唯一絶対の指導原理として微細化し、高性能化、低消費電力化し、さらにチップ面積も低減させ低コスト化することである。再認識すべきは、『スケーリングの本質』は技術的側面としての「性能向上」と経済的側面である「チップ面積低減による低コスト化」を両立であり、だからこそ産業として成長かつ進化し、現代社会の頭脳と神経としてのハードウエアとしてなくてはならぬものとなってきた点である。しかし、最小加工寸法が100nmを切るようになってきた現在、材料、プロセス、インテグレーション、回路、設計、システム、製造コストのすべてにおいて困難な課題が山積みであり、単に微細化しただけでは性能向上が期待できず、かつ産業的なメリットもないという状況にある。科学技術立国を目指すわが国が、基礎から応用までのすべての分野の英知を集め、性能と経済性の両方が向上する『真のスケーリング:True Scaling』を将来にわたって追求できる技術を世界に先駈けて開発しなければならない。本研究は、「回路・システム・アーキテクチャ」の視点から、True Scaling技術を構築する。解決すべき課題としての配線遅延問題の明確化とその解決手段を開拓する。解決手段としては、デジタル集積回路におけるローカル配線やグローバル配線レベルでの信号多重や伝送線路配線回路技術の開発を進め、特に最終年度ではスケーラビリティを有するアナログ高速信号処理回路開発に取り組んだ。65nmや45nm CMOS回路試作を通じて、技術世代進展に伴って性能向上が確保され、且つ面積縮小に伴う低コスト化も保証可能なスケーラビリティを有する回路開発に成功した。

Current Status of Research Progress
Reason

24年度が最終年度であるため、記入しない。

Strategy for Future Research Activity

24年度が最終年度であるため、記入しない。

  • Research Products

    (12 results)

All 2013 2012

All Journal Article (6 results) Presentation (6 results)

  • [Journal Article] An Inductorless Cascaded Phase-Locked Loop with Pulse Injection Locking Technique in 90 nm CMOS2013

    • Author(s)
      Sangyeop Lee, Hiroyuki Ito, Shuhei Amakawa, Noboru Ishihara, and Kazuya Masu
    • Journal Title

      International Journal of Microwave Science and Technology

      Volume: 2013 Pages: ID 584341

  • [Journal Article] An Inverter-Based Wideband Low-Noise Amplifier in 40 nm Complementary Metal Oxide Semiconductor2012

    • Author(s)
      Dayang Nur Salmi Dharmiza, Mototada Oturu, Satoru Tanoi, Hiroyuki Ito, Noboru Ishihara, and Kazuya Masu
    • Journal Title

      Japanese Journal of Applied Physics

      Volume: 51 Pages: 04DE07

    • DOI

      10.1143/JJAP.51.04DE07

  • [Journal Article] 0.1 V 13 GHz Transformer-Based Quadrature Voltage-Controlled Oscillator with a Capacitor Coupling Technique in 90 nm Complementary Metal Oxide Semiconductor2012

    • Author(s)
      Tatsuya Kamimura, Sang-yeop Lee, Satoru Tanoi, Hiroyuki Ito, Noboru Ishihara, and Kazuya Masu
    • Journal Title

      Japanese Journal of Applied Physics

      Volume: 51 Pages: 04DE04

    • DOI

      10.1143/JJAP.51.04DE04

  • [Journal Article] A Ring-VCO-Based Injection-Locked Frequency Multiplier with Novel Pulse Generation Technique in 65nm CMOS2012

    • Author(s)
      Sangyeop Lee, Norifumi Kanemaru, Sho Ikeda, Tatsuya Kamimura, Satoru Tanoi, Hiroyuki Ito, Noboru Ishihara, Kazuya Masu
    • Journal Title

      IEICE Transactions

      Volume: E95-C(10) Pages: 1589-1597

  • [Journal Article] Injection-Locked Fractional Frequency Multiplier with Automatic Reference Pulse-Selection Technique2012

    • Author(s)
      Sangyeop Lee, Hiroyuki Ito, Satoru Tanoi, Noboru Ishihara, Kazuya Masu
    • Journal Title

      IEICE Electronics Express

      Volume: 9(21) Pages: 1624-1629

  • [Journal Article] A Multi-Band Quadrature Clock Generator With High-Pass-Filtered Pulse Injection Technique2012

    • Author(s)
      Sang yeop Lee, Tatsuya Kamimura, Shin Yonezawa, Atsushi Shirane, Sho Ikeda, Hiroyuki Ito, Noboru Ishihara, Kazuya Masu
    • Journal Title

      IEEE MICROWAVE AND WIRELESS COMPONENTS LETTERS

      Volume: 23(2) Pages: 96-98

  • [Presentation] Challenges in Integration of Diverse Functionalities on CMOS2013

    • Author(s)
      Kazuya Masu, Noboru Ishihara, Toshifumi Konishi, Katsuyuki Machida, and Hiroshi Toshiyoshi
    • Organizer
      Proc. 18th Asia and South Pacific Design Automation Conference (ASP-DAC 2013)
    • Place of Presentation
      パシフィコ横浜, Japan
    • Year and Date
      20130122-20130125
  • [Presentation] A 0.5-V 5.5-GHz Class-C-VCO-Based PLL with Ultra-Low-Power ILFD in 65 nm CMOS2012

    • Author(s)
      Sho Ikeda, Tatsuya Kamimura, Sang_yeop Lee, Norifumi Kanemaru, Hiroyuki Ito, Noboru Ishihara, Kazuya Masu
    • Organizer
      IEEE Asian Solid-State Circuits Conference 2012 (ASSCC 2012)
    • Place of Presentation
      Kobe International Conference Center, Japan
    • Year and Date
      20121112-20121114
  • [Presentation] Inductorless Wideband Low Noise Amplifier with Variable Gain in 65nm CMOS2012

    • Author(s)
      Dayang Nur Salmi Dharmiza, Hiroyuki Ito, Noboru Ishihara, and Kazuya Masu
    • Organizer
      2012 Int. Conf. on Solid State Devices and Materials (SSDM 2012)
    • Place of Presentation
      国立京都国際会館, Japan
    • Year and Date
      20120925-20120927
  • [Presentation] Fractionally Injection-Locked Frequency Multiplication Technique with Multi-Phase Ring VCO2012

    • Author(s)
      Sho Ikeda, Sangyeop Lee, Tatsuya Kamimura, Hiroyuki Ito, Noboru Ishihara, and Kazuya Masu
    • Organizer
      2012 Int. Conf. on Solid State Devices and Materials (SSDM 2012)
    • Place of Presentation
      国立京都国際会館, Japan
    • Year and Date
      20120925-20120927
  • [Presentation] A Process-Scalable RF Transceiver for Short Range Communication in 90 nm Si CMOS2012

    • Author(s)
      Atsushi Shirane, Mototada Otsuru, Sang_yeop Lee
    • Organizer
      IEEE Radio Frequency Integrated Circuits Symposium 2012 (RFIC2012)
    • Place of Presentation
      Montreal, Canada
    • Year and Date
      20120617-20120619
  • [Presentation] An inductorless injection-locked PLL with 1/2- and 1/4-integral subharmonic locking in 90 nm CMOS2012

    • Author(s)
      Sang_yeop Lee, Sho Ikeda, Hiroyuki Ito, Satoru Tanoi, Noboru Ishihara, and Kazuya Masu
    • Organizer
      IEEE Radio Frequency Integrated Circuits Symposium 2012 (RFIC2012)
    • Place of Presentation
      Montreal, Canada
    • Year and Date
      20120617-20120619

URL: 

Published: 2014-07-24  

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