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2023 Fiscal Year Annual Research Report

積層半導体基板におけるキャリア輸送特性の高精度抽出法に関する研究

Research Project

Project/Area Number 21K04160
Research InstitutionKansai University

Principal Investigator

佐藤 伸吾  関西大学, システム理工学部, 准教授 (60709137)

Project Period (FY) 2021-04-01 – 2024-03-31
Keywords積層半導体基板 / 伝送線路モデル / チャネル伝導
Outline of Annual Research Achievements

本研究は半導体素子の形成工程を経ることなく、積層構造を有する半導体基板の電気物性・界面品質を、高精度に評価する手法を開発することを目的とする。積層基板向けの電気物性の評価手法であるPseudo-MOS法を交流法に拡張し、積層薄膜界面の電気的品質を評価する手法を開発する。
2023年度は前年度研究で観測された抵抗成分の解析と交流信号のチャネル上伝搬が容量特性に与える影響を検証した。抵抗成分の解析では、抵抗成分の半導体基板内における発生箇所同定のために、試料端からの距離依存性を検証し、抵抗成分が試料端からの距離に対応して単調に増減することを確認した。この結果から金属探針を中心として放射状に広がる抵抗成分であると推定され、その中で交流信号のチャネル上伝搬とは異なる抵抗成分、つまり半導体基板の上層半導体層におけるバルク抵抗に起因することを明らかにした。交流信号のチャネル上伝搬が容量特性に与える影響の解析では、積層半導体基板に印加する直流電圧と印加周波数を変更して解析を行った。低印加周波数(数百Hz以下)では特異な特性は確認されず、積層半導体基板の構造から理論的に予測される標準的な容量電圧特性であったが、高印加周波数(数十kHz)では構造から予測される容量値を超える値が観測された。容量特性の印加周波数依存性を検証した結果、特定周波数で極大値を持ち、その極大値と極大値を示す周波数がチャネル抵抗に依存する特性となっていることが判明した。この結果は過年度に作成した交流信号のチャネル上伝搬を表す解析モデルと対応する結果となっており、本結果をまとめた論文を論文誌に投稿し採択された。

  • Research Products

    (4 results)

All 2024 2023

All Journal Article (2 results) (of which Peer Reviewed: 2 results) Presentation (2 results) (of which Int'l Joint Research: 1 results)

  • [Journal Article] Detailed analysis of the capacitance characteristic measured using the pseudo-metal–oxide–semiconductor method2024

    • Author(s)
      Sato Shingo、Yuan Yifan
    • Journal Title

      Solid-State Electronics

      Volume: 217 Pages: 108950~108950

    • DOI

      10.1016/j.sse.2024.108950

    • Peer Reviewed
  • [Journal Article] Detailed analysis of electrical components on a layered wafer via the AC pseudo-MOS method2023

    • Author(s)
      Yuan Yifan、Sato Shingo
    • Journal Title

      Solid-State Electronics

      Volume: 210 Pages: 108811~108811

    • DOI

      10.1016/j.sse.2023.108811

    • Peer Reviewed
  • [Presentation] AC pseudo-MOS法による積層ウエハ上の電気的成分の詳細解析2024

    • Author(s)
      袁 一凡, 佐藤伸吾
    • Organizer
      先端科学技術シンポジウム2024
  • [Presentation] Detailed analysis of electrical components on a layered wafer with an ac pseudo-MOS method,2023

    • Author(s)
      Y. Yuan, S. Sato
    • Organizer
      EuroSOI-ULIS’2023
    • Int'l Joint Research

URL: 

Published: 2024-12-25  

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