| Project/Area Number |
05212213
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| Research Category |
Grant-in-Aid for Scientific Research on Priority Areas
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| Allocation Type | Single-year Grants |
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| Research Institution | Hiroshima University |
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Principal Investigator |
小柳 光正 広島大学, 集積化システム研究センター, 教授 (60205531)
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| Co-Investigator(Kenkyū-buntansha) |
相原 玲二 広島大学, 集積化システム研究センター, 助教授 (50184023)
横山 新 広島大学, 集積化システム研究センター, 助教授 (80144880)
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| Project Period (FY) |
1993
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| Project Status |
Completed (Fiscal Year 1993)
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| Budget Amount *help |
¥2,300,000 (Direct Cost: ¥2,300,000)
Fiscal Year 1993: ¥2,300,000 (Direct Cost: ¥2,300,000)
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| Keywords | 3次元光結合プロセッサ / 3次元光結合メモリ / 光インターコネクション / 3次元積層化 / マイクロボンディング / 光受動素子 / 光ラムバス・メモリ / 並列処理システム |
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| Research Abstract |
3次元光結合プロセッサエレメント及び3次元光結合メモリ・テストチップを試作するために必要な光インターコネクション技術と3次元積層化技術を確立した。光インターコネクション技術に関しては、まず、発光素子をシリコンLSIチップ上に搭載するためのマイクロボンディング技術を開発し、実際にLSIテストチップ上に搭載することに成功した。発光素子としてはGaAsのLEDを用い、これをポリッシングにより100μm程度にまで薄くしてAu/Inバンプを用いたマイクロボンディングによりLSIテストチップ上に搭載した。この方法によってシリコンチップ上に搭載したLEDチップで均一な発光パターンが得られることを確認した。また、発光素子以外にも光インターコネクションを形成するために必要な光導波路やマイクロレンズ、マイクロミラーなどの光受動素子についても検討し、LSI微細加工技術を利用して良好な光受光素子が形成できることを示した。3次元積層化技術に関しては、シリコンウェーハを1〜10μm程度までに薄くするケミカル・メカニカル・ポリッシング(CMP)技術と多層に積層化するための3次元ウェーハアライナーを開発し、4〜10層程度までのチップの積層化を可能とした。
以上の光インターコネクション技術と3次元積層化技術を用いて3次元光結合メモリLSIテストチップを試作し、光によるデータ書き込みなどの基本的な動作の確認に成功した。この結果を基に、高速のデータ転送機能を持つ並列処理システム用の光ラムバス・メモリ・システムを設計し、光インターコネクションと3次元積層化技術を採用することにより、従来よりも2〜3桁早いデータ転送機能を持つシステムが実現できることを計算機シミュレーションにより明らかにした。
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