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画像処理向け組込みプロセッサのハ-ドウェア/ソフトウェア協調設計手法に関する研究

研究課題

研究課題/領域番号 10750303
研究種目

奨励研究(A)

配分区分補助金
研究分野 システム工学
研究機関早稲田大学

研究代表者

戸川 望  早稲田大学, 理工学部, 助手 (30298161)

研究期間 (年度) 1998 – 1999
研究課題ステータス 完了 (1999年度)
配分額 *注記
2,200千円 (直接経費: 2,200千円)
1999年度: 1,100千円 (直接経費: 1,100千円)
1998年度: 1,100千円 (直接経費: 1,100千円)
キーワードコンピュータ支援設計(CAD) / ハードウェア / ソフトウェア協調設計 / 画像処理 / 組込みプロセッサ / リターゲタッブルアセンブラ / リターゲッタブルシミュレータ / FPGA設計環境 / ソフトウェア分割 / ディジタル信号処理 / コンパイラ
研究概要

平成11年度において,画像処理向け組込みプロセッサのためのハードウェア/ソフトウェア協調設計手法を構築するにあたり,専用ソフトウェアプログラム群自動合成手法に関する研究を行った.さらに,構築されたプロセッサハードウェアの自動合成手法およびそのソフトウェア環境を実ハードウェアとして総合的に評価するために,フィールドプロマブルゲートアレイ(FPGA)設計環境を構築し,実際に,いくつかのハードウェアをFPGAチップ上に実現した.
1.専用ソフトウェアプログラム群自動合成手法の構築
画像処理向け組込みプロセッサのハードウェア/ソフトウェア協調設計では,与えられたアプリケーションプログラムに特化したプロセッサハードウェアとそのプロセッサ上で動作するソフトウェア環境を自動合成する.本年度の研究では,専用ソフトウェア環境として,リターゲッタブルアセンブラならびにリターゲッタブルシミュレータを構築した.これらのアセンブラならびにシミュレータはいずれも,自動合成される画像処理向け組込みプロセッサハードウェアに応じて,その機能を可変とすることができ,その結果,通常のRISC型マイクロプロセッサからDSP型(ディジタル信号処理型)プロセッサに至る広範囲のプロセッサに対応できることを確認した.
2.FPGA設計環境の構築とその応用
これまでの研究において構築されたプロセッサハードウェアの自動合成手法およびそのソフトウェア環境を実ハードウェア上で評価するために,FPGA設計環境を構築した.FPGA設計環境は,FPGAチップとしてXilinx XC4000シリーズを複数個用いることを可能とし,実現すべきハードウェア規模に応じて,任意の拡張性を持つことに特長がある.実際に,小規模プロセッサあるいはアプリケーションプログラムを,2個のFPGAチップを用いて実現し,その有効性を実証した.

報告書

(2件)
  • 1999 実績報告書
  • 1998 実績報告書
  • 研究成果

    (10件)

すべて その他

すべて 文献書誌 (10件)

  • [文献書誌] 戸川望: "制御処理を主体としたハ-ドウェアを対象とする高位合成システムとその適用"情報処理学会DAシンポジウム'99論文集. 189-194 (1999)

    • 関連する報告書
      1999 実績報告書
  • [文献書誌] 横山正幸: "制御処理を主体としたハ-ドウェア記述生成手法"情報処理学会DAシンポジウム'99論文集. 195-200 (1999)

    • 関連する報告書
      1999 実績報告書
  • [文献書誌] 戸川望: "A hardware/software cosynthesis system for digital singnal processor cores"IEICE Transactions on Fundamentals of Electronics,Communications and Computer Sciences. E82-A・11. 2325-2337 (1999)

    • 関連する報告書
      1999 実績報告書
  • [文献書誌] 戸川望: "An area/time optimizing algorithm in high-level synthesis for control-based hardwares"Proceedings of IEEE Asia and South Pacific Design Automation Conference. 309-312 (2000)

    • 関連する報告書
      1999 実績報告書
  • [文献書誌] 戸川望: "A hardware/software cosynthesis system for digital signal processor cores with two types of register files"IEICE Transactions on Fundamentals of Electronics,Communications and Computer Sciences. E83-A・3. (2000)

    • 関連する報告書
      1999 実績報告書
  • [文献書誌] 戸川 望: "An FPGA layout reconfiguration algorithm based on global routes for engineering changes in system design specifications" IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences. E81-A, 5. 873-884 (1998)

    • 関連する報告書
      1998 実績報告書
  • [文献書誌] 戸川 望: "A fast scheduling algorithm based on gradual time-frame reduction for datapath synthesis" IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences. E81-A, 6. 1231-1241 (1998)

    • 関連する報告書
      1998 実績報告書
  • [文献書誌] 戸川 望: "Maple-opt:A performance-oriented simultaneous technology mapping, placement, and global routing algorithm for FPGAs" IEEE Trans.on Computer-Aided Design of Integrated Circuits and Systems. 17,9. 803-818 (1998)

    • 関連する報告書
      1998 実績報告書
  • [文献書誌] 戸川 望: "A high-level synthesis system for digital signal processing based on data-flow graph enumeration" IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences. E81-A, 12. 2563-2575 (1998)

    • 関連する報告書
      1998 実績報告書
  • [文献書誌] 戸川 望: "A hardware/software partitioning algorithm for processor cores of digital signal processing" Proceedings of IEEE Asia and South Pacific Design Automation Conference. 335-338 (1999)

    • 関連する報告書
      1998 実績報告書

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公開日: 1998-04-01   更新日: 2016-04-21  

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