| 研究課題/領域番号 |
15300022
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| 研究種目 |
基盤研究(B)
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| 配分区分 | 補助金 |
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| 応募区分 | 一般 |
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| 研究分野 |
計算機システム・ネットワーク
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| 研究機関 | 慶應義塾大学 |
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研究代表者 |
天野 英晴 慶應義塾大学, 理工学部, 教授 (60175932)
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| 研究分担者 |
小栗 清 長崎大学, 工学部, 教授 (80325670)
柴田 裕一郎 長崎大学, 工学部, 教授 (10336183)
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| 研究期間 (年度) |
2003 – 2005
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| 研究課題ステータス |
完了 (2005年度)
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| 配分額 *注記 |
9,600千円 (直接経費: 9,600千円)
2005年度: 700千円 (直接経費: 700千円)
2004年度: 3,900千円 (直接経費: 3,900千円)
2003年度: 5,000千円 (直接経費: 5,000千円)
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| キーワード | Reconfigurable System / Virtual Hardware / Dvnamic Reconfiguration / Network on Chip / Multicontext device / Dynamic Reconfiguration / Network On Chip / Multicontext Devices / Multicontext Reconfigurable Devices / Dynamic Adaptive Hardware / Dynamic Reconfigurable Processor / Multicontext Device |
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| 研究概要 |
マルチコンテキストデバイスの仮想ハードウェア機構を確立するために、以下の成果を得た。
1.NEC社のマルチコンテキストデバイスDRP上にストリーム処理を中心としたアプリケーションを実装し、面積効率の理論的解析を行った。その結果、4倍から14倍の改善が実現されることが明らかになった。
2.DRP用の仮想ハードウェア機構を用いて(1)IPsec(2)Viterbiでデコーダを実装した。IPsecは、複数の暗号化、復号化回路を必要とする。これらを個別にDRP上に実装し、要求に応じて回路構成を切り替える方式を実現した。また、複数の能力の違ったViterbiデコーダを受信状況に応じて回路構成を切り替える適応型Viterbiデコーダを実装した。この機能により消費電力を最大半分に削減可能である。
3.DRP用の仮想ハードウェア機構を効率良く動作させるための、入出力転送機構を提案した。この手法は、入出力用コンテキストを独立動作させると共に、ダブルバッファ機構を導入して入出力時間の隠蔽を可能とする。この機構の導入によって、1で実装したストリームアプリケーションすべてに対して入出力時間の隠蔽が可能になった。
4.DRPのコアを複数チップ上に搭載する際に利用するオンチップ結合方式Black-busを提案した。この方式は、データ転送路とあて先のローカルラベルを併走させることで、少ないハードウェアでパケット転送を実現する。また、接続用のネットワーク接続方式としてFat H-Treeを提案した。
5.仮想ハードウェアの実現には再構成の高速化が必要である。このために、テンプレート再構成法、および構成データのマルチキャスト法を提案し、評価を行った。
これらの成果に基づき、FPL, FCCM, ICFPTなど著名な国際学会で発表を行った。また、Singapoleで開催されたDigital Convergence2004にてキーノートスビーチを行った。さらに2003年度の成果論文がIEICE英文誌論文賞を、2005年度の成果が先進的基盤シンポジウムSACSIS2006で若手優秀研究賞を受賞した。
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