• 研究課題をさがす
  • 研究者をさがす
  • KAKENの使い方
  1. 前のページに戻る

大規模グラフ処理のための再構成可能カスタムアクセラレータの開発

研究課題

研究課題/領域番号 15J04973
研究種目

特別研究員奨励費

配分区分補助金
応募区分国内
研究分野 高性能計算
研究機関東北大学

研究代表者

武井 康浩  東北大学, 情報科学研究科, 特別研究員(DC2)

研究期間 (年度) 2015-04-24 – 2017-03-31
研究課題ステータス 採択後辞退 (2016年度)
配分額 *注記
1,700千円 (直接経費: 1,700千円)
2016年度: 800千円 (直接経費: 800千円)
2015年度: 900千円 (直接経費: 900千円)
キーワードカスタムアクセラレータ / 大規模グラフ処理 / FPGA
研究実績の概要

本年度の研究実績として、外部ストレージとのデータ転送時間を削減するためのグラフデータ圧縮法、および最短経路検索の計算に必要な中間結果の記憶量の削減手法を提案した。
大規模グラフにおける最短経路検索を処理する場合において、入力グラフのデータ量が外部メモリ以上の場合は転送帯域の小さいストレージを使用する必要があり、転送時間が増大する。そのため、コンパクトな記憶量と高効率な処理を両立する簡潔データ構造を入力グラフに適用して、データ伸長のためのハードウェアをFPGAに実装した。アメリカの道路ネットワーク(2395万ノード、5833万エッジ)を簡潔グラフ化した場合のデータ量について、エッジのアドレスを示すIndex情報のデータ量が88%削減されていることが確認された。しかしながら,エッジの重みと接続ノードを示すデータ量が大きいため、グラフ全体のデータ量の削減率が18%にとどまっていることが確認されたため、テキスト圧縮を応用したデータ圧縮法の応用を検討している。
最短経路検索における中間結果の記憶量削減について、最短経路問題のアルゴリズムであるダイクストラ法におけるノードアクセスの順序を考慮して、現在ノードにおける距離のデータを専用レジスタに記憶して、新たに現在ノードに隣接した未確定ノードのデータを前の現在ノードデータに上書きできるアクセラレータをFPGAに実装した。格子グラフにおける1 点対全点最短経路問題の処理中にノードメモリに格納されるノードデータ数について、全体のノード数の約1/3 程度であることが確認された。また、 FPGAアクセラレータの処理性能の見積もりをCPUと比較すると,ノード数が4096 のグラフの最短経路検索に対して,CPU の約60 倍の処理速度になる見積もりが得られた。

現在までの達成度 (段落)

翌年度、交付申請を辞退するため、記入しない。

今後の研究の推進方策

翌年度、交付申請を辞退するため、記入しない。

報告書

(1件)
  • 2015 実績報告書
  • 研究成果

    (3件)

すべて 2015

すべて 雑誌論文 (1件) (うち査読あり 1件、 オープンアクセス 1件) 学会発表 (2件) (うち国際学会 2件)

  • [雑誌論文] Data-Transfer-Aware Design of an FPGA-Based Heterogeneous Multicore Platform with Custom Accelerators2015

    • 著者名/発表者名
      Yasuhiro Takei, Hasitha Muthumala Waidyasooriya, Masanori Hariyama and Michitaka Kameyama
    • 雑誌名

      IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences

      巻: E98.A 号: 12 ページ: 2658-2669

    • DOI

      10.1587/transfun.E98.A.2658

    • NAID

      130005111969

    • ISSN
      0916-8508, 1745-1337
    • 関連する報告書
      2015 実績報告書
    • 査読あり / オープンアクセス
  • [学会発表] Evaluation of an FPGA-Based Shortest-Path-Search Accelerator2015

    • 著者名/発表者名
      Yasuhiro Takei, Masanori Hariyama and Michitaka Kameyama
    • 学会等名
      International Conference on Parallel and Distributed Processing Techniques and Applications (PDPTA)
    • 発表場所
      Las Vegas,USA
    • 年月日
      2015-07-29
    • 関連する報告書
      2015 実績報告書
    • 国際学会
  • [学会発表] FPGA-Oriented Design of an FDTD Accelerator Based on Overlapped Tiling2015

    • 著者名/発表者名
      Yasuhiro Takei, Hasitha Muthumala Waidyasooriya, Masanori Hariyama and Michitaka Kameyama
    • 学会等名
      International Conference on Parallel and Distributed Processing Techniques and Applications (PDPTA)
    • 発表場所
      Las Vegas,USA
    • 年月日
      2015-07-29
    • 関連する報告書
      2015 実績報告書
    • 国際学会

URL: 

公開日: 2015-11-26   更新日: 2024-03-26  

サービス概要 検索マニュアル よくある質問 お知らせ 利用規程 科研費による研究の帰属

Powered by NII kakenhi