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学習型スマート情報処理を実現する集積回路アーキテクチャの開拓

研究課題

研究課題/領域番号 18J10772
研究種目

特別研究員奨励費

配分区分補助金
応募区分国内
研究分野 ソフトコンピューティング
研究機関北海道大学

研究代表者

肥田 格  北海道大学, 大学院情報科学研究科, 特別研究員(DC2)

研究期間 (年度) 2018-04-25 – 2020-03-31
研究課題ステータス 完了 (2018年度)
配分額 *注記
1,900千円 (直接経費: 1,900千円)
2018年度: 1,000千円 (直接経費: 1,000千円)
キーワード脳型情報処理 / 機械学習 / 深層学習 / ニューラルネットワーク / アナログ電子回路 / アーキテクチャ / 抵抗変化型メモリ / メモリスタ
研究実績の概要

メモリスタを用いた脳型情報処理回路の学習方法の開拓を試みた。メモリスタによるアナログ・ニューラルネットワーク演算回路の低電力深層学習回路への拡張を目指し、配線上の困難の克服や回路面積を従来の1/4に縮小するような、デバイス・アウェアな学習則を開発した。
(1)Locally-connected Convolutional Deep Belief Network (LCCDBN)
3次元積層されたメモリスタの層間配線トポロジを活用し、畳込みDeep Belief Network(CDBN)として利用するために、配線の複雑化を緩和する階層別教師なし事前学習法および局所的な結合による畳込みをCDBNに適用した。得られたLCCDBNは、画像に対する特徴抽出器として、従来のCDBNと同等の性能を獲得し、さらに未学習の画像データセットに対する転移学習も可能であることを示した。一連の結果をまとめた論文は、Nonlinear Theory and Its Applications (2018)に掲載された。
(2)重み符号固定学習法
深層ニューラルネットワークの各シナプス結合重みに対し、正負符号の反転が伴う学習を禁止する制約を課しても、符号非制約下の場合と同等の汎化能力を学習し得ることを明らかにした。従来は1個の重みに対し2個のメモリスタ素子を用いて、作動的に正負両方の符号に対応していた。本手法を適用した場合、各重みの学習中・学習後の符号は学習前の符号と常に同一であるため、1個の素子で1個の重みを表現することができ、必要素子数が半減される。クロスバー構造を利用した全結合型アナログ・ニューラルネットワークの場合では、メモリセルおよび配線の圧縮により回路面積が1/4に縮小され、さらなる低電力化が見込まれる。

現在までの達成度 (段落)

翌年度、交付申請を辞退するため、記入しない。

今後の研究の推進方策

翌年度、交付申請を辞退するため、記入しない。

報告書

(1件)
  • 2018 実績報告書
  • 研究成果

    (2件)

すべて 2018

すべて 雑誌論文 (1件) (うち査読あり 1件、 オープンアクセス 1件) 学会発表 (1件)

  • [雑誌論文] Structural exploration of stochastic neural networks for severely-constrained 3D memristive devices2018

    • 著者名/発表者名
      Achararit P., Hida I., Marukame T., Asai T., and Hara-Azumi Y.
    • 雑誌名

      Nonlinear Theory and Its Applications, IEICE

      巻: 9 号: 4 ページ: 466-478

    • DOI

      10.1587/nolta.9.466

    • NAID

      130007490648

    • ISSN
      2185-4106
    • 関連する報告書
      2018 実績報告書
    • 査読あり / オープンアクセス
  • [学会発表] On the neuromorphic 3D devices for locally-connected convolutional neural network2018

    • 著者名/発表者名
      Achararit Paniti, 肥田 格, 丸亀 孝生, 浅井 哲也, 原 祐子
    • 学会等名
      日本神経回路学会第28回全国大会
    • 関連する報告書
      2018 実績報告書

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公開日: 2018-05-01   更新日: 2024-03-26  

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