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アナログ信号の機械学習のためのアナログ・デジタル混在再構成システム

研究課題

研究課題/領域番号 18K11223
研究種目

基盤研究(C)

配分区分基金
応募区分一般
審査区分 小区分60040:計算機システム関連
研究機関北九州市立大学

研究代表者

中武 繁寿  北九州市立大学, 国際環境工学部, 教授 (10282831)

研究期間 (年度) 2018-04-01 – 2021-03-31
研究課題ステータス 完了 (2020年度)
配分額 *注記
4,290千円 (直接経費: 3,300千円、間接経費: 990千円)
2020年度: 1,820千円 (直接経費: 1,400千円、間接経費: 420千円)
2019年度: 1,430千円 (直接経費: 1,100千円、間接経費: 330千円)
2018年度: 1,040千円 (直接経費: 800千円、間接経費: 240千円)
キーワードセンサノード / 機械学習ハードウェア / パーセプトロン回路 / ニューラルネットワーク / アナログ・デジタル混在回路 / 機械学習 / アナログ・パーセプトロン回路 / DACベース乗算器 / 低電力ニューラルネットワーク回路 / 低電力ニューラルネットネットワーク回路 / アナログ再構成システム / アナログ・パーセプトロン / 生体センシング
研究成果の概要

本研究では、ニューラルネットワークの不可欠な機能であるパーセプトロンに焦点を当て、入力に対する重み和の演算に相当するDAC型乗算器、および活性化関数ReLUに相当するソースフォロア回路を用いて実現し、センサノードに搭載を目的としたハードウェアの軽量化を図る。そのため、提案パーセプトロン回路を伴う多層化ニュートラルネットワークの回路・レイアウト設計を行い、CMOS0.6umプロセスによるチップ試作、測定評価を実施した。その結果、ニュートラルネットワークとしての基本的な動作の確認ができ、さらにFPGAによる従来のデジタル実装の回路と比較し、面積、消費電力の尺度で優位性を示すことができた。

研究成果の学術的意義や社会的意義

本研究では、ニュートラルネットワークのアナデジ混在の実装方法およびその優位性を示すことにより、現在主流のデジタル実装以外の選択肢を見出すことができた。また、提案回路を実際のチップ試作・測定により評価することにより、その方式の妥当性に実装面からの説得性を与えることができた。この研究をさらに発展させることにより、センサーノードの軽量化が進み、多数のセンサを必要とする、例えば、ブレイン・マシン・インターフェースへの応用も期待できる。

報告書

(4件)
  • 2020 実績報告書   研究成果報告書 ( PDF )
  • 2019 実施状況報告書
  • 2018 実施状況報告書
  • 研究成果

    (19件)

すべて 2021 2020 2019 2018

すべて 雑誌論文 (11件) (うち国際共著 3件、 査読あり 11件、 オープンアクセス 1件) 学会発表 (8件) (うち国際学会 2件)

  • [雑誌論文] Approximate Decomposition of Multi-output LUTs under Acceptable Error Tolerance2021

    • 著者名/発表者名
      Xuechen Zang, Shigetoshi Nakatake, Hiroyuki Kozutsumi, Mitsunori Katsu, Shoichi Sekiguch
    • 雑誌名

      Proceedings of SASIMI2021

      巻: 1 ページ: 137-141

    • 関連する報告書
      2020 実績報告書
    • 査読あり
  • [雑誌論文] Implementation of Analog Perceptron as an Essential Element of Configurable Neural Networks2020

    • 著者名/発表者名
      Chao Geng, Qingji Sun, Shigetoshi Nakatake
    • 雑誌名

      Sensors

      巻: 20 号: 15 ページ: 4222-4222

    • DOI

      10.3390/s20154222

    • 関連する報告書
      2020 実績報告書
    • 査読あり / オープンアクセス
  • [雑誌論文] An Analog CMOS Implementation for Multi-layer Perceptron With ReLU Activation2020

    • 著者名/発表者名
      Chao Geng, Qingji Sun, Shigetoshi Nakatake
    • 雑誌名

      Proceedings of MOCAST2020

      巻: 1 ページ: 1-6

    • DOI

      10.1109/mocast49295.2020.9200299

    • 関連する報告書
      2020 実績報告書
    • 査読あり
  • [雑誌論文] A Fully Synthesizable, 0.3V, 10nW Rail-to-rail Dynamic Voltage Comparator2020

    • 著者名/発表者名
      Xuncheng Zou, Shigetoshi Nakatake
    • 雑誌名

      Proceedings of MWSCAS2020

      巻: 1 ページ: 199-202

    • DOI

      10.1109/mwscas48704.2020.9184498

    • 関連する報告書
      2020 実績報告書
    • 査読あり
  • [雑誌論文] A Low Voltage Stochastic Flash ADC without Comparator2019

    • 著者名/発表者名
      Xuncheng Zou, Shigetoshi Nakatake
    • 雑誌名

      IEICE Transactions on Fundamentals

      巻: 102-A(7) ページ: 886-893

    • NAID

      130007670857

    • 関連する報告書
      2019 実施状況報告書
    • 査読あり
  • [雑誌論文] On-chip resistance configuration by subthreshold MOSFET-array for ultra weak current sensing2019

    • 著者名/発表者名
      Xinghuai Zhang, Shigetoshi Nakatake
    • 雑誌名

      Proceedings of IEEE APCCAS2019

      巻: 1 ページ: 261-264

    • 関連する報告書
      2019 実施状況報告書
    • 査読あり
  • [雑誌論文] An Impedance Measurement of Intravesical Urine Volume Appropriate to Seated Posture2019

    • 著者名/発表者名
      Ryosuke Sakai, Shigetoshi Nakatake
    • 雑誌名

      Proceedings of IEEE APCCAS2019

      巻: 1 ページ: 385-388

    • 関連する報告書
      2019 実施状況報告書
    • 査読あり
  • [雑誌論文] Density Optimization for Analog Layout Based on Transistor-Array. IEICE Transactions2019

    • 著者名/発表者名
      Chao Geng, Bo Liu, Shigetoshi Nakatake
    • 雑誌名

      IEICE Transactions on Fundamentals

      巻: 102-A(12) ページ: 1720-1730

    • 関連する報告書
      2019 実施状況報告書
    • 査読あり
  • [雑誌論文] Low Voltage CMOS Current Mode Reference Circuit without Operational Amplifiers2018

    • 著者名/発表者名
      Kenya Kondo, Koichi Tanno, Hiroki Tamura, Shigetoshi Nakatake
    • 雑誌名

      IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences

      巻: 101-A (5) ページ: 748-754

    • NAID

      130006729412

    • 関連する報告書
      2018 実施状況報告書
    • 査読あり / 国際共著
  • [雑誌論文] Analog perceptron circuit with DAC-based multiplier2018

    • 著者名/発表者名
      Yoritaka Ishiguchi, Daishi Isogai, Takuma Osawa, Shigetoshi Nakatake
    • 雑誌名

      Integration

      巻: 63 ページ: 240-247

    • 関連する報告書
      2018 実施状況報告書
    • 査読あり / 国際共著
  • [雑誌論文] Routable and Matched Layout Styles for Analog Module Generation2018

    • 著者名/発表者名
      Bo Liu, Gong Chen, Bo Yang, Shigetoshi Nakatake
    • 雑誌名

      ACM Transactions on Design Automation of Electronic Systems

      巻: 23(4)

    • 関連する報告書
      2018 実施状況報告書
    • 査読あり / 国際共著
  • [学会発表] 汎用論理スイッチを伴うPLA再構成デコーダの設計とポストレイアウトシミュレーション検証2019

    • 著者名/発表者名
      石川大暉・八尋信之・中武繁寿
    • 学会等名
      電子情報通信学会 コンピュータシステム研究会
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] アナデジ混在パーセプトロン回路におけるDAC型乗算回路に関する検討2019

    • 著者名/発表者名
      野口仁一郎・中武繁寿
    • 学会等名
      電子情報通信学会 コンピュータシステム研究会
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] OpenSource Multi-functional Memory Unit andApplication to Approximate Computing2019

    • 著者名/発表者名
      Shigetoshi Nakatake
    • 学会等名
      IEEE HPEC2019
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] Approximate Function Configuration by Neural Network on Memory-array Unit2019

    • 著者名/発表者名
      Xuechen Zang, Shigetoshi Nakatake, Hiroyuki Kozutsumi, Mitsunori Katsu, Shoichi Sekiguchi
    • 学会等名
      SASIMI2019
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] Ultra Low Current Measurement with On-chip High Resistance of MOSFET Array2019

    • 著者名/発表者名
      Xinghuai Zhang, Daishi Isogai, Takaaki Shirakawa, Shigetoshi Nakatake
    • 学会等名
      SASIMI2019
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] An Intravesical Urine Volume Sensor Robust to Body Posture and Movement2019

    • 著者名/発表者名
      Ryousuke Sakai, Shigetoshi Nakatake
    • 学会等名
      SASIMI201
    • 関連する報告書
      2019 実施状況報告書
  • [学会発表] Analog Neural Circuit with DAC-based Perceptron2018

    • 著者名/発表者名
      Yoritaka Ishiguchi and Shigetoshi Nakatake
    • 学会等名
      Workshop on Hardware and Algorithms for Learning On-a-chip (HALO) 2018
    • 関連する報告書
      2018 実施状況報告書
    • 国際学会
  • [学会発表] Approximate Computing in Memory with PLA-based Reconfigurable Decoder2018

    • 著者名/発表者名
      Nobuyuki Yahiro and Shigetoshi Nakatake
    • 学会等名
      Workshop on Hardware and Algorithms for Learning On-a-chip (HALO) 2018
    • 関連する報告書
      2018 実施状況報告書
    • 国際学会

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公開日: 2018-04-23   更新日: 2022-01-27  

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