研究課題
基盤研究(B)
1. 高比誘電率~100、低リーク電流密度10^<-5>A/cm^2、高絶縁破壊電圧0.5MV/cmのTiOxゲート絶縁膜を実現(一部論文発表及び新規論文準備中)2. TiOxゲート絶縁膜による、ソース・ドレイン間隔4ナノメーター(電気的に10ナノメーター)極微小MISゲートトランジスタのE/D動作を実現(一部論文発表及び新規論文準備中)2. TiOxゲート絶縁膜による、ソース・ドレイン間隔4ナノメーター(電気的に10ナノメーター)極微小MISゲートトランジスタのE/D動作を実現(一部論文発表及び新規論文準備中)3. フォトキャパシタンス法によるTiOx及びSrTiOx絶縁膜中のノンストイキオメトリ欠陥電子準位を解明(一部論文発表及び新規論文準備中)
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Journal of Physics and Chemistry of Solids Volume 69,Issues 2-3
ページ: 708-713
Physical Status Solidi(c)4 No.5
ページ: 1723-1726