研究課題
スケーラブルな物理セキュリティを可能にする近似計算の設計基盤と理論の構築に向けて、(a)スケーラブルな物理セキュリティを可能にする近似演算回路の開発、(b)物理セキュリティ強度要求に応じたACマスキング回路の自動合成技術の開発、(c)スケーラブルな物理セキュリティに関する安全性指標の理論の構築について研究を実施した。サブテーマ(a)に関しては、AES暗号回路において情報漏洩の危険性が大きいSboxについて、電源および電磁波サイドチャネル漏洩を低減するためのカスタム設計を行った。対象回路を搭載した実証チップを製造し、物理攻撃に対するセキュリティ耐性とそのコストのトレードオフを実機評価した。また、近似加算器において、2の補数表現の負の数を扱う場合の誤差が処理結果に与える影響を解析した。サブテーマ(b)に関しては、マスキング対策が行われていないAES回路とマスキング対策が行われたAES回路を高位合成により設計し、電力サイドチャネル攻撃耐性を評価した。また、高位合成の最適化とTIを組み合わせた、ARX暗号回路の耐タンパ回路設計手法を提案した。さらに、電力サイドチャネル攻撃に対して堅牢な小型・省電力プロセッサを開発した。サブテーマ(c)に関しては、NISTの認証付き暗号候補について、乱数生成器の周波数を変更させた場合のTVLAへの影響を評価し、近似計算との関係について調査を行った。また、サイドチャネル攻撃（SCA）と差分フォルト分析（DFA）両方の対策になるM&M AESのAES S-boxに対し、乗算マスク方式を実装評価した。さらに、FPGA実装された暗号システム向けのサイドチャネルマスキングのためのノイズ注入技術や、近似計算を用いた擬似乱数生成器に対する故障注入攻撃に関する研究を行った。
令和5年度が最終年度であるため、記入しない。
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